Quiz
Junio 2013
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Perguntas do quiz (20)
1Desde el punto de vista del estudio del rendimiento de un sistema computador, por lo general si se reduce el tiempo de ciclo de reloj:
- ASe reduce también su frecuencia
- BSe aumentan los ciclos por instrucción
- CSe aumenta su productividad y se reduce su tiempo de C respuesta
- DNinguna de las afirmaciones anteriores es correcta
2Sea un computador A capaz de completar 10000 tareas/seg, si se dice la productividad del computador A es un 50% superior a la productividad del computador B:
- AEl computador B realiza 3333,33 tareas en 1 seg
- BEl computador B requiere de 1,5 segundos para realizar el mismo número de tareas
- CEl computador A tarda 0,5 seg en cada tarea
- DEl computador A realiza 15000 tareas en el mismo tiempo que el computador B realiza 7500 tareas
3En cuanto a la mejora del rendimiento, indica cuál de las siguientes afirmaciones es cierta
- ALa optimización de todos los casos garantiza el mayor rendimiento
- BEl mayor rendimiento se obtiene optimizando el caso más común
- CEl rendimiento puede mejorarse de forma ilimitada
- DLa mejora del rendimiento global se obtiene optimizando el caso menos común
4Indica la afirmación que NO es cierta:
- AEl tiempo de CPU depende del ciclo de reloj
- BEl tiempo de CPU depende de los ciclos por instrucción
- CEl tiempo de CPU depende de número de instrucciones ejecutadas
- DNinguna de las afirmaciones anteriores es correcta
5Sea un sistema computador con microprocesador Intel i7 a 3,4 GHz, si después de pasarle un Benchmark se obtiene que es capaz de ejecutar 128300 MIPS:
- ASe estima que ejecuta 26500 instrucciones en un ciclo
- BSe estima que cada instrucción requiere de 0,0265 ciclos para su ejecución
- CSe puede decir que cada ciclo de reloj dura 3,4 seg
- DFaltan datos para conocer el promedio del número de ciclos por instrucción
6Respecto a la memoria caché, el tiempo de penalización por fallos:
- ADisminuye a medida que aumenta el tamaño de bloque.
- BEs constante.
- CAumenta a medida que aumenta el tamaño de bloque.
- DDepende exponencialmente con el tamaño de bloque.
7Los mecanismos de gestión de la memoria caché se resuelven con componente hardware:
- APara cumplir el requisito de menor uso de memoria
- BPara cumplir el requisito de menor tiempo posible
- CLa afirmación es incorrecta, se resuelven con software
- DNinguna de las afirmaciones anteriores es correcta
8Respecto a los algoritmos de reemplazo de la memoria caché, sea un bloque que acaba de entrar en la memoria
- ATiene mayor probabilidad de salir si se aplica LRU
- BTiene mayor probabilidad de salir en cualquier caso
- CTiene mayor probabilidad de salir si se aplica FIFO
- DTiene mayor probabilidad de salir si se aplica LFU
9En relación al tamaño de bloque:
- AA mayor tamaño, menores fallos forzosos pero mayores fallos de conflicto
- BA mayor tamaño, menor tasa de fallos
- CA mayor tamaño, menores fallos forzosos y menores fallos de conflicto
- DA mayor tamaño, mayor número de conjuntos
10Atendiendo a los niveles de caché, se puede afirmar que
- AUn mayor número de niveles garantiza siempre un menor tiempo de acceso
- BA mayor número de niveles, mayor capacidad de almacenamiento
- CUn mayor número de niveles garantiza siempre un menor tiempo de ejecución relativo
- DNinguna de las afirmaciones anteriores es correcta
11Según el esquema de computador Von Neumann sencillo estudiado en el Tema 3, la operación R4 ←R7:
- ASe realiza comunicando el bus de direcciones con el bus de datos
- BNo es posible realizarla en este sistema computador
- CImplica hacer uso del circuito operador de propósito general
- DEs necesario realizarla como mínimo en dos periodos
12En un computador serie y referido a la misma instrucción, si la fase de decodificación de una instrucción se realiza durante un único ciclo de reloj, ¿puede solaparse con la fase de búsqueda de operando?:
- ASi
- BDepende de la instruccion
- CNo
- DDepende del modo de direccionamiento de la instrucción
13Una unidad de control microprogramada con secuenciamiento explícito
- ANo tiene etapa traductora ni memoria de control
- BNecesita etapa traductora y memoria de control
- CSu registro de microinstrucción es de menor tamaño
- DNo necesita etapa traductora, y sí memoria de control
14Sea el computador Von Neumann estudiado en el Tema 3, la información del registro RF permite
- AConocer la posición de memoria de la instrucción
- BConocer el valor de los biestables de Z, S, O, P
- CNo es útil para la ejecución de la instrucción
- DConocer la fase de ejecución de la instrucción en curso
15De las siguientes instrucciones, indica en cuál de ellas se almacena el contenido del registro SR en memoria
- ADIV .1, .2 con trap por división por cero
- BRET y RETI
- CCALL A0002h y DIV .1, .2 con trap
- DEn ninguna de las instrucciones indicadas
16La capacidad de direccionamiento del procesador DLX es de
- A6 Mposiciones
- B4 Mposiciones
- C4 Gposiciones
- D2 Gposiciones
17Decir que todas las instrucciones del procesador DLX siguen el modelo de ejecución REG-REG es:
- AFalso
- BCierto
- CPuede ser cierto o falso dependiendo del ensamblador
- DNinguna de las afirmaciones anteriores es cierta
18¿Cuál es el tipo de riesgo por dependencia de datos que se presenta en el fragmento de código ensamblador siguiente si se ejecuta en un procesador DLX segmentado con bypass generalizado?
LD R3, 12(R3)
ST 12(R3), R2- AWAR
- BRAW
- CWAW
- DNinguno
19Cuál de las siguientes técnicas suele utilizarse para eliminar riesgos estructurales
- ADisminuir el nº de líneas de transmisión de datos y buses
- BUtilizar caches partidas para datos e instrucciones
- CIncrementar la velocidad del reloj del sistema
- DLas políticas dinámicas de predicción de saltos
20Los riesgos de tipo WAW:
- APueden existir en DLX
- BNo existen en DLX
- CSon riesgos estructurales
- DSon riesgos de control
Informações
- Descrição
- Arquitectura Quiz sobre Junio 2013, criado por dbx.loling em 05-06-2015.
- Autor
- dbx.loling
- Idioma
- Español
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- Avaliação
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