Test
Tema 3
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Preguntas del test (25)
1Un pipeline de profundidad N:
- ADivide por N el ancho de banda necesario de la versión sin pipeline.
- BMultiplica por N el ancho de banda necesario de la versión sin pipeline.
- CDivide por N el throughput de la versión sin pipeline.
- DMultiplica por N el throughput de la versión sin pipeline.
2Con el uso de una arquitectura segmentada:
- ADisminuye el throughput.
- BMantiene inalterado el throughput.
- CAumenta el throughput.
- DDisminuye la latencia.
3En un pipeline, la técnica del forwarding se utiliza para resolver:
- ADependencia de datos de tipo WAR.
- BDependencias de datos de tipo RAW.
- CDependencias de control.
- DDependencias de datos de tipo WAW.
4La predicción de bifurcaciones basada en perfil de ejecución:
- ANo depende de la carga de trabajo concreta.
- BSe basa en que cada bifurcación de un programa está fuertemente
sesgada. - CNo requiere la recogida de estadísticas.
- DSe utiliza habitualmente por la mayoría de los compiladores.
5En el caso de una predicción de salto a no-tomado:
- ALa predicción se resuelve en tiempo de ejecución.
- BEl compilador puede poner la opción más frecuente como tomada e invertir la
condición si es necesario. - CEl compilador puede poner la opción más frecuente como no-tomada e invertir la condición si es necesario.
- DEl compilador no puede hacer nada.
6En el desenrollamiento de bucles:
- AAumenta la longitud del bloque básico.
- BNo es necesario realizar ningún ajuste al código de terminación.
- CDisminuye la longitud del bloque básico.
- DSe pueden reutilizar los mismos registros para distintas réplicas.
7Un predictor con correlación (2,2) con 4K entradas requiere:
- A8KB.
- B4KB.
- C32KB.
- D16KB.
8En un procesador superescalar especulativo:
- ALa detección de riesgos es especulativa.
- BLa planificación es dinámica con especulación.
- CLa ejecución especulativa es en orden.
- DLa emisión de instrucciones es especulativa.
9La principal desventaja de la planificación dinámica de instrucciones es:
- AEl código optimizado para un pipeline no ejecuta de forma eficiente en otro pipeline distinto.
- BNo puede tolerar retrasos no predecibles.
- CEl hardware necesario es más complejo.
- DNo gestiona las dependencias conocidas en tiempo de compilación.
10En el multi-hilo de grano fino:
- AEl procesador debe poder cambiar de hilo en cada ciclo de reloj.
- BSe necesita una tabla de renombrado por hilo.
- CSe necesitan grandes conjuntos de registros virtuales.
- DNo hace falta un cambio de contexto excesivamente rápido.
11En el multi-hilo de grano grueso:
- AEl procesador debe poder cambiar de hilo en cada ciclo de reloj.
- BSe debe vaciar o congelar el pipeline.
- CHacen falta ROB (reorder buffer) separados.
- DSe pueden ocultar detenciones cortas y largas.
12En un procesador MIPS con un pipeline de cinco etapas, la actualización del contador de programa se realiza en la etapa de:
- AEjecución.
- BCaptación.
- CMemoria.
- DDecodificación.
13En un pipeline, los riesgos estructurales:
- ASe producen si no se separa la caché de instrucciones de la de datos.
- BSon evitables, pero se encarece el hardware.
- CSe producen debido a unidades funcionales totalmente segmentadas.
- DA veces no se pueden evitar.
14En un predictor por turnos, la selección del predictor se realiza:
- AUsando un algoritmo round-robin.
- BDe forma alternativa.
- CMediante una máquina de estados finitos.
- DMediante un contador con saturación.
15La ejecución especulativa de instrucciones:
- AEs una técnica de planificación estática.
- BRequiere predicción dinámica y planificación dinámica.
- CEs una técnica de predicción de instrucciones.
- DPredice el código de operación de la siguiente instrucción antes de captarla.
16En un procesador MIPS con un pipeline de cinco etapas:
- ALa latencia ideal es de 5 ciclos y el throughput es de 1 instrucción por ciclo.
- BLa latencia ideal es de 1 ciclo y el throughput es de 1 instrucción por ciclo.
- CLa latencia ideal es de 5 ciclos y el throughput es de 5 instrucciones por ciclo.
- DLa latencia ideal es de 1 ciclo y el throughput es de 5 instrucciones por ciclo .
17Un riesgo de tipo WAW:
- ASe conoce también como anti-dependencia.
- BPuede darse en un MIPS con pipeline de cinco etapas.
- CSe conoce también como dependencia de salida.
- DSe conoce también como dependencia verdadera.
18La efectividad aproximada del compilador para las bifurcaciones retrasadas con una ranura de retraso viene dada por el siguiente hecho:
- ARellena en torno al 80% de los slots de forma útil.
- BRellena en torno al 60% de los slots de forma útil.
- CRellena en torno al 50% de los slots de forma útil.
- DRellena en torno al 100% de los slots de forma útil.
19Se denomina bloque básico a:
- AUna secuencia de instrucciones sin saltos.
- BUna bloque de código que se puede invocar desde varios puntos del programa.
- CUna secuencia de instrucciones en la que todos los saltos son incondicionales.
- DUna secuencia de instrucciones que no incluye operaciones load/store.
20Un riesgo de tipo WAR:
- APuede darse en un MIPS con pipeline de cinco etapas.
- BSe conoce también como dependencia de salida.
- CSe conoce también como anti-dependencia.
- DSe conoce también como dependencia verdadera.
21Un predictor de saltos por turnos:
- AAlterna entre los estados tomado y no-tomado.
- BCombina un predictor local y un predictor global.
- CCombina dos predictores locales.
- DCombina dos predictores globales.
22En un procesador MIPS con un pipeline de cinco etapas, la extensión de signo de los desplazamientos se realiza en la etapa de:
- ADecodificación.
- BMemoria.
- CCaptación.
- DEjecución.
23La aproximación más simple, de forma general, ante un riesgo es:
- ADetener el flujo de datos.
- BPredecir siempre los saltos a no-tomado.
- CDetener el flujo de instrucciones.
- DVaciar el pipeline.
24En el caso de una predicción de salto a tomado:
- AEl compilador puede poner la opción más frecuente como no-tomada e invertir la condición si es necesario.
- BEl compilador puede poner la opción más frecuente como tomada e invertir la condición si es necesario.
- CEl compilador no puede hacer nada.
- DLa predicción se resuelve en tiempo de ejecución.
25En un procesador superescalar estático:
- ALa detección de riesgos debe realizarse por el compilador.
- BNo hay ejecución fuera de orden.
- CLa emisión de instrucciones es estática.
- DLa planificación de instrucciones es dinámica.
Información
- Descripción
- Arqui Arqui Test sobre Tema 3, creado por Alberto Gonzalez el 22/01/2018.
- Autor
- Alberto Gonzalez
- Idioma
- Español
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